Logic Synthesis and Verification Algorithms - Gary D. Hachtel - Libros - Springer-Verlag New York Inc. - 9781475770360 - 18 de marzo de 2013
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Gary D. Hachtel
Logic Synthesis and Verification Algorithms Softcover reprint of the original 1st ed. 1996 edition

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Logic Synthesis and Verification Algorithms is a textbook designed for courses on VLSI Logic Synthesis and Verification, Design Automation, CAD and advanced level discrete mathematics. Logic Synthesis and Verification Algorithms is about the theoretical underpinnings of VLSI (Very Large Scale Integrated Circuits).

596 pages, biography

Medios de comunicación Libros     Paperback Book   (Libro con tapa blanda y lomo encolado)
Publicado 18 de marzo de 2013
ISBN13 9781475770360
Editores Springer-Verlag New York Inc.
Páginas 564
Dimensiones 178 × 254 × 31 mm   ·   1,03 kg
Lengua Inglés  

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